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组合逻辑电路任意时刻的稳定输出只由该时刻的输入信号取值组合决定,而与原电路状态无
组合逻辑电路任意时刻的稳定输出只由该时刻的输入信号取值组合决定,而与原电路状态无
免费考试题库
2019-12-17
36
问题
组合逻辑电路任意时刻的稳定输出只由该时刻的输入信号取值组合决定,而与原电路状态无关。()
选项
答案
对
解析
这是组合逻辑电路最重要的特性。
转载请注明原文地址:https://ti.zuoweng.com/ti/vT8EKKKQ
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