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  3. 组合逻辑电路任意时刻的稳定输出只由该时刻的输入信号取值组合决定，而与原电路状态无

组合逻辑电路任意时刻的稳定输出只由该时刻的输入信号取值组合决定，而与原电路状态无

免费考试题库2019-12-17  46
问题 组合逻辑电路任意时刻的稳定输出只由该时刻的输入信号取值组合决定，而与原电路状态无关。()
选项
答案对
解析这是组合逻辑电路最重要的特性。
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